Cadence常見問題
1. Q: 想移動元件的某一個PIN ， 請問該如何做。用move 命令， 總提示Symbol or drawing must have UNFIXED_PINS property。
A: edit -> properties 選中要move Pin的元件的 symbols，增加 UNFIXED_PINS 屬性即可。
2.Q: how can i get rid of the "dynamic length" dialogue box?
A: Setup -> User Preferences Editor ->Etch>allegro_etch_length_on
3 .Q： 請問如何將以刪除的PIN NUMBER及SILKSCREEN還原??
A：刪除此零件,再重新導入~~~或可以直接UPDATE 零件也可以
4. Q：從orcad導入后，place->quickplace，但是出來的元件上面很多絲橫，就和鋪銅一樣，怎么回事?
A：把PACKAGE GEOMETRY 的 PLACE_BOUND_TOP 勾掉即可.
5. Q：請問在allegro中,怎様畫一條沒有綠漆的綫??
A：同樣位置再畫一根sold mask的線
6. Q： 如何將走線的尖角過渡改成圓弧?
A：可以直接畫圓弧上去，記得勾上replace etch，原來的線就沒了或使用slide 命令﹐然后在右邊的tab option選項中的comers改成arc,再去移動線﹐就可以改成圓弧﹗
7.Q： allegro中覆銅的基本步驟是怎樣的?
A：edit/shape進入shape編輯模式——edit/change net(pick)點上GND net——shape/parameters設置相關參數(看help)——void/auto進行shape處理——shape/fill退出shape編輯模式。
Cadence軟件功能
1、圖形化、平面化和層次化設計能力提高了原理圖設計效率;
2、與強大的元件信息系統(CIS)高度集成，促進優選器件和已有器件庫的重用，可以加快原理圖設計進程，降低項目成本;
3、便于查找元件，并與MRP、ERP、PDM數據庫實現高度集成;
4、為用戶提供超過200萬的免費元件庫，便于靈活選擇設計元件;
5、集中管理物料編號和器件信息;
6、可進行數據流程、封裝以及互聯的在線設計規則檢查;
7、用戶可以對元件、連線、網絡、引腳和標題框進行靈活的編輯和定義;
8、可以導入和導出所有常用的設計文件格式;
9、宏記錄器可用于復雜的原理圖編輯和定制過程的錄制。
10、對模擬電路不僅可進行直流、交流、瞬態等基本電路特性分析，而且可進行參數掃描分析和統計分析。
Cadence軟件特色
設計分割
設計團隊越來越分散于世界各地，這就讓縮短設計周期時間的相關問題變得更加復雜，手動操作解決多用戶問題非常耗時， 緩慢而且易于出錯，PCB設計分割技術， Allegro PCB設計層有提供，提供了多用戶， 同步的設計方法，實現了更快地上市，并減少了布局時間，使用該技術，同時作業于一個布局圖的多個設計師可以共同調用單個數據庫，不管小組相隔多遠，設計分割技術讓設計師能夠將設計分割為多個部分或者區域，由多個設計組成員進行規劃和編輯， 這樣，所有設計師都可以查看所有被分割的部分，并更新設計視窗，監控其他用戶部分的狀態和進度，這可以大大縮短整個設計周期，并加速設計流程。
交互式走線編輯
PCB編輯器的交互式布線功能提供了強大的，交互的功能，可以使受控自動操作，以維持用戶操作，同時將布線效率最大化，實時的，圖形的，任意角度的推擠布線讓用戶可以選擇，推擠優先，，環繞優先，或，僅環繞，模式，推擠優先模式讓用戶可以建造最合適的互聯路徑，而實時的，圖形布線器會自動地解決動態推擠障礙，布線會自動跳躍障礙，如引腳或導孔，在需要建造數據總線時，貼線優先模式是完美的解決方案，在環繞優先模式中，布線器圖形會跟隨其它互聯為優先，只有在沒有選擇的時候才會推開或跳過障礙，僅環繞型執行起來就像環繞優先模式，但沒有對其它蝕刻目標的推擠意圖，實時嵌入式圖形布線引擎可以通過推擠障礙，或者跟隨銅皮的障礙，同時動態地跳躍過孔或元件引腳以優化布線，在編輯時，設計師可以使用一種能夠顯示具有高速約束的互聯下的時序間隙的實時圖形化窗口，互聯布線還提供了在多個線路上執行群組布線的能力，以及用高速長度或延遲約束進行線路的交互式調整的能力
動態鋪銅
動態鋪銅技術提供了實時灌注/修復功能， Shape參數可以被適用于三個不同的方面， 參數可以被添加到全局Shape， 同類Shape， 以及單個Shape中，走線，導孔和元件添加到動態銅皮中，將會按照其形狀自動連接或避讓，當物體被移去時，形狀會自動填充回去，在編輯完成后，動態鋪銅不需要批量自動避讓，也不需要其它的后期加工步驟， RF設計RF設計要求包括要比以往更快，更精確地解決高性能/高頻率電路，RF/復合信號技術為PCB RF設計提供了一種完整的，從前端到后端，從原理圖到布局到制造的解決方案，RF技術包含了高級的RF性能，包括參數化創建和編輯RF器件的智能布局功能， 以及一種靈活的圖形編輯器，一種雙向的IFF界面提供了RF電路數據的快速而有效地傳輸，并進行仿真和確認，這種雙向流程消除了電路仿真和布局之間手動和易于出錯的迭代，Allegro PCB Design XL和GXL級提供了此功能
PCB制造
可以進行全套底片加工，裸板裝配和測試輸出，包括各種格式的Gerber 274x，NC Drill和裸板測試，更重要的是，CADENCE通過其Valor ODB++界面，還包含Valor Universal Viewer，支持業界倡導的Gerber-Less制造， ODB++數據格式可創建精確而可靠的制造數據，進行高質量的Gerber-Less制造
自動化的互聯環境
設計復雜度，密度和高速布線約束的提高使PCB的手動布線既困難又耗時，復雜的互聯布線問題通過強大的，自動化的技術得以解決，這種強大的，經實踐證明的自動布線器含有一種批量布線模式，含有眾多的用戶可定義的布線策略，以及自動的策略調整，互動的布線環境，具有實時互動走線推擠特性，有助于對走線的快速編輯，具有廣泛的布圖規劃功能和完整的元件放置特點的互動式放置環境，使得無需切換應用程序就可以進行放置變更，優化布線，通過使用自動交互式布圖規劃和放置功能，設計師可以提高布線質量和效率，這與元件布局直接相關，此外，廣泛的規則集讓設計師可以控制范圍廣泛的約束，從默認的板級規則到按照線路種類的規則，再到區域規則，Allegro產品提供的高速布線能力能夠解決線路安排，時序，串擾，布線層的設置，和當今高速電路所需要的特殊器件要求。
自動布線
高級自動布線技術提供了強大的，基于形狀的自動布線，有快速，高效率等特點，它的布線算法可對于類型廣泛的PCB互連挑戰，從簡單到復雜，從低密度到高密度，并可滿足高速約束的需要，這些強大的算法最高效率地使用了布線區域，為了給各種情形找到最佳的布線方案，布線器使用一種多通路，重視成本，可解決沖突的算法，廣泛的規則集提供了物理和電子約束控制的能力，廣泛的規則集具有解決設計中各種布線元素的特定規則的靈活性，用戶可以定義滿足通用物理/間距線路規則所需的規則，和復雜，層級高速規則的分類規則
可制造性設計
制造性設計能力可以大大提高制造的良品率，制造算法提供了伸展功能，能夠根據可用空間自動地加大銅皮間隙，自動銅皮伸展，將銅皮重新定位，創造銅皮與引腳，銅皮與SMD焊盤，以及相鄰銅皮之間的額外空間，從而提高可制造性，用戶可以靈活地定義各種范圍的間距值，或者使用默認值， 臨近的拐角和測試點可以被添加到布線過程中，制造算法會自動使用最優的規則范圍，從最大值開始直到最小值，測試點插入可自動添加到可以測試的導孔或焊盤作為測試點，可測試的導孔可以在前端，后端或PCB的兩邊被探測到，支持單面和蛤殼式測試器，設計師可以根據它們的制造需要，靈活選擇測試點插入方法，為了避免昂貴的測試設備調整，測試點可以是，固定，的，測試點約束包括測試探測表面，導孔尺寸，導孔柵格，和最小的中心間距。
互動式布線編輯
布線編輯器可以簡化走線編輯過程，隨著新的走線，推擠功能會自動推開原有的走線，圍繞引腳進行布線，使用推擠功能，設計師可以沿著現有的走線移動原有的走線部分或導孔，并且在必要的時候推到其它引腳和導孔前端，重像功能使其更容易評估假定的情況，隨著走線部分或導孔在指針控制下移動，周圍的走線就會被推擠和動態顯示，這樣經調整的布線可以在接收最終配置前被評估，布線編輯器非常適合密集的多層電路板，有效導孔的位置很難發現，只要在選定的地點點擊兩次就可以定位導孔，可能的話，可以通過將走線推擠到所需的板層上創造出可選地點，如果不可行，布線編輯器會顯示出DRC，并顯示附近的有效導孔位置，此外，復制布線功能可以讓現有的布線被復制，以完成未布線的總線連接，簡化總線的創建。
布局編輯
布局編輯器讓設計師迅速放置元件的同時可以同步評估空間，邏輯流程和擁擠度，移動模式讓元件可以被作為單一元件或群組進行翻轉，旋轉，排列，推擠和移動，指導布局模式選擇具有最高連通性的元件，計算出其最理想的位置，而不會破壞設計規則或約束，用戶可以拒絕也可以接受該位置， 只要直接輸入XY軸位置就可以放置元件， 這種功能對于放置連接器和有固定位置的元件特別實用，密度分析可以通過將PCB與顯示區域范圍的色圖，從高度擁擠到輕微擁擠的區域，重疊，圖形化地顯示了電路的擁擠度，這有助于確認在哪里進行布局調整，以緩解擁擠度，并提高布線完成率
高速約束
高速布線約束和算法能夠滿足當今高速電路的差分對，線路布局，時序，串擾，布線層的設置和特殊的幾何要求，對于差分對布線，用戶只需定義兩個走線之間的間距，而自動布線器會解決剩下的一切，布線算法可以智能地處理導孔周圍或之間的布線， 并自動順應指定的長度或時序標準，自動網絡屏蔽被用于降低噪聲敏感型線路中存在的干擾，不同的設計規則可以被應用于設計的不同部分，例如，用戶可以在設計的走線部分指定嚴格的間距規則，而在其它地方指定沒那么嚴格的規則。
PCB編輯器集成
PCB布線技術被緊密結合到PCB編輯器中， 通過PCB編輯器界面，所有設計信息和約束被自動傳遞到布線器，一旦布線完成，所有布線信息會自動傳回到PCB編輯器， 圖6，布局編輯器容許你在布線過程的所有階段評估空間，邏輯流程和擁擠度。
Cadence更新日志
1.修復部分bug
2.優化了部分功能
提取碼: vkva
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